第1篇 模擬集成電路工程師崗位職責(zé)
射頻與模擬集成電路工程師 北京御芯微科技有限公司 北京御芯微科技有限公司,御芯微 1. 微電子、電子工程類本科及以上學(xué)歷;
2. 從事rfic設(shè)計(jì)工作5年以上,能完成諸如lna、mixer、filter、pga、ad、da、pll和pa等射頻集成電路設(shè)計(jì)。有功率放大器(pa)量產(chǎn)經(jīng)驗(yàn)優(yōu)先;
3. 獨(dú)立進(jìn)行射頻電路模塊的設(shè)計(jì),其中包括電路結(jié)構(gòu)的確立、行為級和電路級的仿真。對soc芯片有一定了解,能夠配合數(shù)字工程師完成soc系統(tǒng)級建模與仿真。
4. 具備良好的射頻、模擬版圖能力,能夠獨(dú)立完成版圖工作或指導(dǎo)版圖工程師完成工作;
5. 完成設(shè)計(jì)文檔、測試方案等項(xiàng)目文件的編寫,能協(xié)助測試工程師完成芯片測試、性能評估和問題分析。
6. 對集成電路流片、封裝、測試有深入的了解,能夠在設(shè)計(jì)中對產(chǎn)品周期、成本進(jìn)行合理化控制,能對公司產(chǎn)品規(guī)劃提出合理化建議。
7. 具備良好的團(tuán)隊(duì)合作精神及技術(shù)學(xué)習(xí)能力,工作敬業(yè)負(fù)責(zé),具備較強(qiáng)動(dòng)手能力。
第2篇 模擬集成電路設(shè)計(jì)工程師崗位職責(zé)
崗位職責(zé):
1、負(fù)責(zé)新模擬ip的定義,仿真,設(shè)計(jì);
2、負(fù)責(zé)模擬ip的數(shù)據(jù)手冊文檔更新,編寫,維護(hù);
3、負(fù)責(zé)模擬ip的測試,評價(jià),維護(hù);
4、參與soc芯片規(guī)格定義,芯片測試和量產(chǎn)支持
5、參與電源管理方向或者audio codec方向,ic規(guī)格定義,項(xiàng)目開發(fā),芯片測試和量產(chǎn)支持
相關(guān)技能要求:
1、了解半導(dǎo)體器件物理與工藝等相關(guān)基礎(chǔ)知識(shí);
2、能夠獨(dú)立分析并設(shè)計(jì)如下模塊或其中之一:
op;pga;osc;adc;dac;dcdc;ldo;codec等ip模塊;
3、會(huì)使用實(shí)驗(yàn)室基本測試設(shè)備進(jìn)行ip測試,評價(jià)與分析。
4、有低功耗codec設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮
5、有高速adc/dac ip設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮
6、有高精度sigma-delta adc/dac ip設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮
7、dc/dc 設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮
8、良好的文檔能力,能夠高質(zhì)量撰寫各類工作報(bào)告
9、要求具備團(tuán)隊(duì)合作精神,自我激勵(lì),能夠按進(jìn)度及計(jì)劃完成任務(wù)
第3篇 模擬集成電路版圖設(shè)計(jì)工程師崗位職責(zé)
崗位職責(zé):
1. 根據(jù)電路設(shè)計(jì), 對芯片的版圖,封裝等進(jìn)行布局, 規(guī)劃;
2. 負(fù)責(zé)完成相關(guān)電路的版圖實(shí)現(xiàn);
3. 合理應(yīng)用晶圓廠的制程,有效提升整體電路性能;
4. 配合版圖設(shè)計(jì)工程師完成電路版圖設(shè)計(jì);
能力要求:
1. 精通運(yùn)算放大器, 比較器, 鎖相環(huán), 模擬數(shù)字轉(zhuǎn)換器,電荷泵等模塊的版圖設(shè)計(jì);
2. 精通esd 設(shè)計(jì)原則
3. 精通各種封裝技術(shù)者優(yōu)先
4. 熟悉半導(dǎo)體工藝流程,熟悉代工廠pdk等設(shè)計(jì)文件;
5. 有5年以上ic設(shè)計(jì)經(jīng)驗(yàn),熟練ic設(shè)計(jì)流程和eda工具;
6. 微電子、電子工程等相關(guān)專業(yè)本科或以上學(xué)歷;
